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PCI-Express(peripheral component interconnect express)是一種高速串行計(jì)算機(jī)擴(kuò)展總線(xiàn)標(biāo)準(zhǔn)，它原來(lái)的名稱(chēng)為“3GIO”，是由英特爾在2001年提出的，旨在替代舊的PCI，PCI-X和AGP總線(xiàn)標(biāo)準(zhǔn)。PCIe屬于高速串行點(diǎn)對(duì)點(diǎn)雙通道高帶寬傳輸，所連接的設(shè)備分配獨(dú)享通道帶寬，不共享總線(xiàn)帶寬，主要支持主動(dòng)電源管理，錯(cuò)誤報(bào)告，端對(duì)端的可靠性傳輸，熱插拔以及服務(wù)質(zhì)量(QOS)等功能。PCIe交由PCI-SIG（PCI特殊興趣組織）認(rèn)證發(fā)布后才改名為“PCI-Express”，簡(jiǎn)稱(chēng)“PCI-e”。它的主要優(yōu)勢(shì)就是數(shù)據(jù)傳輸速率高，而且還有相當(dāng)大的發(fā)展?jié)摿ΑCI Express也有多種規(guī)格，從PCI Express x1到PCI Express x32，能滿(mǎn)足將來(lái)一定時(shí)間內(nèi)出現(xiàn)的低速設(shè)備和高速設(shè)備的需求。PCI-Express的接口是PCIe 3.0接口

PCI-Express(peripheral component interconnect express)是一種高速串行計(jì)算機(jī)擴(kuò)展總線(xiàn)標(biāo)準(zhǔn)，它原來(lái)的名稱(chēng)為“3GIO”，是由英特爾在2001年提出的，旨在替代舊的PCI，PCI-X和AGP總線(xiàn)標(biāo)準(zhǔn)。PCIe屬于高速串行點(diǎn)對(duì)點(diǎn)雙通道高帶寬傳輸，所連接的設(shè)備分配獨(dú)享通道帶寬，不共享總線(xiàn)帶寬，主要支持主動(dòng)電源管理，錯(cuò)誤報(bào)告，端對(duì)端的可靠性傳輸，熱插拔以及服務(wù)質(zhì)量(QOS)等功能。PCIe交由PCI-SIG（PCI特殊興趣組織）認(rèn)證發(fā)布后才改名為“PCI-Express”，簡(jiǎn)稱(chēng)“PCI-e”。它的主要優(yōu)勢(shì)就是數(shù)據(jù)傳輸速率高，而且還有相當(dāng)大的發(fā)展?jié)摿?。PCI Express也有多種規(guī)格，從PCI Express x1到PCI Express x32，能滿(mǎn)足將來(lái)一定時(shí)間內(nèi)出現(xiàn)的低速設(shè)備和高速設(shè)備的需求。PCI-Express的接口是PCIe 3.0接口收起

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  • 【硬核開(kāi)箱】ZX7981PM 插卡 CPE 實(shí)測(cè) 雙卡切換 + 多模組適配 中小企業(yè)網(wǎng)絡(luò)神器實(shí)錘
    ZX7981PM 的價(jià)格僅6百出頭，它能同時(shí)替代 “路由器 + 雙卡切換器 + 模組拓展塢”，還能提供 2.5G 高速接口和網(wǎng)絡(luò)冗余，對(duì)需要穩(wěn)定網(wǎng)絡(luò)的中小企業(yè)來(lái)說(shuō)，簡(jiǎn)直是省下了買(mǎi)備用設(shè)備的錢(qián)。
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    22小時(shí)前
  • PCIe協(xié)議學(xué)習(xí)資料推薦！
    本文給大家推薦一些學(xué)習(xí)PCIe協(xié)議規(guī)范的書(shū)籍和資料。介紹PCIe體系結(jié)構(gòu)的中文書(shū)籍有兩本，英文書(shū)籍有一本Mindshare 的PCI Express Technology 3.0，但是最權(quán)威最準(zhǔn)確的還是PCIe spec規(guī)范，但是直接讀spec讀可能比較晦澀，可以先看一些系統(tǒng)性的中文資料介紹等。
    PCIe協(xié)議學(xué)習(xí)資料推薦！
  • 一文詳解PCIe熱插拔原理
    PCIe熱插拔（Hot Plug）是指允許在系統(tǒng)運(yùn)行時(shí)不關(guān)閉電源即可安全插入或拔出PCIe設(shè)備，其廣泛應(yīng)用于服務(wù)器和數(shù)據(jù)中心等場(chǎng)景。PCIe熱插拔是提升系統(tǒng)RAS能力的重要手段。
    一文詳解PCIe熱插拔原理
  • 顛覆傳統(tǒng)存儲(chǔ)，SSD加速創(chuàng)新
    當(dāng)ChatGPT、DeepSeek等大模型不斷涌現(xiàn)，占據(jù)熱搜話(huà)題榜，當(dāng)AI 30秒生成一篇論文、自動(dòng)駕駛汽車(chē)每秒生成20GB感知數(shù)據(jù)，一場(chǎng)由AI驅(qū)動(dòng)的存儲(chǔ)革命已經(jīng)正式開(kāi)啟，高容量和卓越性能的存儲(chǔ)解決方案成為“剛需”，未來(lái)SSD有望挑起大梁，助力AI時(shí)代下存儲(chǔ)器產(chǎn)業(yè)新一輪發(fā)展。
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  • Synopsys PCIe IP架構(gòu)簡(jiǎn)介
    當(dāng)前，Synopsys公司的PCIe IP在整個(gè)市場(chǎng)中占據(jù)著主導(dǎo)地位。憑借在PCIe IP領(lǐng)域超過(guò)20年的專(zhuān)業(yè)經(jīng)驗(yàn)，Synopsys為AI、HPC、網(wǎng)絡(luò)、存儲(chǔ)、移動(dòng)和汽車(chē)SoC提供下一代設(shè)計(jì)所需的低延遲和高性能連接，
    Synopsys PCIe IP架構(gòu)簡(jiǎn)介
  • YXC低抖動(dòng)HCSL差分晶振助力PCIE 5.0
    PCIE協(xié)議下的參考時(shí)鐘基本為100MHz HCSL輸出，要求確保數(shù)據(jù)傳輸?shù)恼_性和穩(wěn)定性，解決時(shí)鐘抖動(dòng)、偏移和噪聲問(wèn)題。
    YXC低抖動(dòng)HCSL差分晶振助力PCIE 5.0
  • 知名上市公司-PCIe架構(gòu)
    前PCIe時(shí)代：PCI（1992）采用32位并行總線(xiàn)，133MB/s帶寬很快被3D圖形和千兆網(wǎng)絡(luò)卡擊穿瓶頸；革命性轉(zhuǎn)折（2003）：PCIe 1.0采用差分串行架構(gòu)，2.5GT/s速率實(shí)現(xiàn)雙500MB/s帶寬
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    03/19 08:31
  • 泰克自動(dòng)化接收器測(cè)試方案，提升PCIe測(cè)試驗(yàn)證精度與效率
    近二十年來(lái)，PCI Express技術(shù)已成為廣泛采用的高速串行接口連接標(biāo)準(zhǔn)。最新的 PCIe規(guī)范滿(mǎn)足了數(shù)據(jù)密集型市場(chǎng)的需求，例如人工智能/機(jī)器學(xué)習(xí)和高性能計(jì)算。泰克PCIe 自動(dòng)化測(cè)試解決方案能夠處理設(shè)置和校準(zhǔn)，顯著降低了測(cè)試復(fù)雜性。與低噪音測(cè)量硬件相結(jié)合，可實(shí)現(xiàn)快速、準(zhǔn)確且可重復(fù)的信號(hào)完整性測(cè)量。作為 PCI-SIG工作組的活躍投票成員，泰克擁有發(fā)射機(jī)、接收機(jī)、參考時(shí)鐘和鎖相環(huán) (PLL) 驗(yàn)證
    泰克自動(dòng)化接收器測(cè)試方案，提升PCIe測(cè)試驗(yàn)證精度與效率
  • PCIe 6.0借AI開(kāi)啟商用，7.0即將登場(chǎng)
    大部分人連 PCIe 4.0 都未普及，即使是 PCIe 5.0的產(chǎn)品也只是少量推出，不過(guò)廠(chǎng)商們才不管這些，甚至開(kāi)始推出PCIe 6.0的產(chǎn)品了。例如著名的主控廠(chǎng)商慧榮就已經(jīng)開(kāi)始為 PCIe 6.0 準(zhǔn)備新的主控芯片，最高速度或許可以突破 30GB/s。PCIe 6.0的標(biāo)準(zhǔn)已經(jīng)推出三年，如今商業(yè)化落地的曙光已現(xiàn)。
    PCIe 6.0借AI開(kāi)啟商用，7.0即將登場(chǎng)
  • 強(qiáng)烈推薦一款查看Windows下設(shè)備信息的軟件！USB/PCIE一覽無(wú)余！
    在linux系統(tǒng)中，我們要查看硬件信息，通常通過(guò)lspci、lsusb、top、vmstat、free、iostat 等命令，或者/proc/cpuinfo、/proc/net/dev等文件節(jié)點(diǎn)。
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    02/15 15:16
  • Xilinx PCIe高速接口入門(mén)實(shí)戰(zhàn)（四）
    本文介紹PCIe IP核時(shí)鐘結(jié)構(gòu)、PCIe板卡時(shí)鐘方案及復(fù)位設(shè)計(jì)相關(guān)內(nèi)容。集成塊輸入系統(tǒng)時(shí)鐘信號(hào)稱(chēng)為sys_clk，該時(shí)鐘頻率必須為100MHz、125MHz或250MHz。使用的時(shí)鐘頻率必須與Vivado IDE中的時(shí)鐘頻率選擇相匹配。
    Xilinx PCIe高速接口入門(mén)實(shí)戰(zhàn)（四）
  • Xilinx PCIe高速接口入門(mén)實(shí)戰(zhàn)（三）
    為保證FPGA設(shè)備可以連接并被系統(tǒng)識(shí)別，本節(jié)討論了PCIe基礎(chǔ)規(guī)范和PCIe板卡電氣規(guī)范的對(duì)FPGA配置時(shí)間具體要求。在PCIe的標(biāo)準(zhǔn)系統(tǒng)中，當(dāng)系統(tǒng)通電時(shí)，處理器上運(yùn)行的配置軟件開(kāi)始掃描PCIe總線(xiàn)以發(fā)現(xiàn)機(jī)器拓?fù)?。掃描PCIe層次結(jié)構(gòu)以確定其拓?fù)浣Y(jié)構(gòu)的過(guò)程稱(chēng)為枚舉過(guò)程，根復(fù)合體（RC）通過(guò)向設(shè)備發(fā)起配置事務(wù)來(lái)實(shí)現(xiàn)枚舉過(guò)程。?
    Xilinx PCIe高速接口入門(mén)實(shí)戰(zhàn)（三）
  • PCIe over Optics：引領(lǐng)AI互聯(lián)與傳輸?shù)男聲r(shí)代
    隨著生成式AI技術(shù)的蓬勃發(fā)展，我們正步入一個(gè)萬(wàn)物存儲(chǔ)、萬(wàn)物智能、萬(wàn)物互聯(lián)的全新時(shí)代。在這個(gè)時(shí)代里，數(shù)據(jù)的洪流如潮水般涌來(lái)，對(duì)數(shù)據(jù)中心的基礎(chǔ)設(shè)施提出了前所未有的挑戰(zhàn)。為了滿(mǎn)足AI模型日益增長(zhǎng)的計(jì)算需求，大型語(yǔ)言模型（LLM）需要同時(shí)處理海量的多模態(tài)數(shù)據(jù)集，包括文本、圖像、音頻和視頻等，這促使AI處理資源的需求急劇上升，并需要在整個(gè)數(shù)據(jù)中心內(nèi)實(shí)現(xiàn)高效互連。
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    2024/12/13
    PCIe over Optics：引領(lǐng)AI互聯(lián)與傳輸?shù)男聲r(shí)代
  • Xilinx PCIe高速接口入門(mén)實(shí)戰(zhàn)（二）
    本文詳細(xì)介紹7 Series Intergrated Block for PCI ExpressPCIe硬核IP接口功能描述及PCIe配置空間相關(guān)內(nèi)容。
    Xilinx PCIe高速接口入門(mén)實(shí)戰(zhàn)（二）
  • Xilinx PCIe高速接口入門(mén)實(shí)戰(zhàn)（一）
    本文對(duì)Xilinx 7 Series Intergrated Block for PCI Express PCIe硬核IP進(jìn)行簡(jiǎn)要介紹，主要包括7系列FPGA PCIe硬核資源支持、三IP硬核差異、PCIe硬核資源利用等相關(guān)內(nèi)容。
    Xilinx PCIe高速接口入門(mén)實(shí)戰(zhàn)（一）
  • 為什么大廠(chǎng)不愿意使用英偉達(dá)的NVLink？
    在當(dāng)前的GPU和加速計(jì)算領(lǐng)域，英偉達(dá)（NVIDIA）無(wú)疑是領(lǐng)先的技術(shù)提供者，其開(kāi)發(fā)的NVLink技術(shù)是一項(xiàng)革命性的高速互連技術(shù)，旨在加速GPU之間以及GPU與主機(jī)CPU之間的通信。然而，盡管NVLink技術(shù)具有顯著的優(yōu)勢(shì)，許多大廠(chǎng)仍然選擇不采用這一技術(shù)，而是使用其他技術(shù)或開(kāi)發(fā)自己的互連方案。那么，是什么原因使得這些廠(chǎng)商在選擇互連技術(shù)時(shí)對(duì)NVLink保持謹(jǐn)慎？我們將從多個(gè)角度進(jìn)行詳細(xì)分析。
    為什么大廠(chǎng)不愿意使用英偉達(dá)的NVLink？
  • PCIe 7.0 互連— PCIe的盡頭會(huì)是光嗎？
    伴隨大語(yǔ)言模型和相關(guān)訓(xùn)練系統(tǒng)迅猛增長(zhǎng)、對(duì)非結(jié)構(gòu)化數(shù)據(jù)處理的需求急劇上升，市場(chǎng)對(duì)算力的需求也是呈指數(shù)級(jí)增加。PCIe作為計(jì)算機(jī)和服務(wù)器中使用廣泛的高速數(shù)據(jù)傳輸技術(shù)發(fā)展迅猛，今年4月份PCI-SIG已經(jīng)批準(zhǔn) Draft 0.5版基礎(chǔ)規(guī)范，目前0.7版本基礎(chǔ)規(guī)范正在審核中，預(yù)計(jì)2025年敲定最終發(fā)行版本。
    PCIe 7.0 互連— PCIe的盡頭會(huì)是光嗎？
  • PCIE工程bd上ddr3和xdma ip核通過(guò)axi connect.互聯(lián)，數(shù)據(jù)怎么交互？
    今天給大俠帶來(lái)在FPAG技術(shù)交流群里平時(shí)討論的問(wèn)題答疑合集（二十八），以后還會(huì)多推出本系列，話(huà)不多說(shuō)，上貨。Q：有個(gè)pcie工程，bd上有ddr3和xdma ip核。通過(guò)axi connect.互聯(lián)。數(shù)據(jù)怎么交互？
    PCIE工程bd上ddr3和xdma ip核通過(guò)axi connect.互聯(lián)，數(shù)據(jù)怎么交互？
  • Xilinx 7系列FPGA PCI Express IP核簡(jiǎn)介
    Xilinx?7系列FPGA集成了新一代PCI Express集成塊，支持8.0Gb/s數(shù)據(jù)速率的PCI Express 3.0。本文介紹了7系列FPGA PCIe Gen3的應(yīng)用接口及一些特性。
    Xilinx 7系列FPGA PCI Express IP核簡(jiǎn)介
  • 萬(wàn)億參數(shù)模型的數(shù)據(jù)遷移挑戰(zhàn)巨大，PCIe7.0如何提升AI芯片帶寬？
    有關(guān)人工智能（AI）快速發(fā)展的新聞報(bào)道層出不窮，與此同時(shí)，對(duì)先進(jìn)、高效的硬件基礎(chǔ)結(jié)構(gòu)的需求也變得愈加迫切。大語(yǔ)言模型（LLM）越來(lái)越復(fù)雜，所需參數(shù)量每四到六個(gè)月就會(huì)翻一番。事實(shí)上，GPT-4的參數(shù)量超過(guò)一萬(wàn)億！這個(gè)數(shù)字看似很直白，但其所對(duì)應(yīng)的數(shù)據(jù)量龐大到令人咋舌──2萬(wàn)億字節(jié)就相當(dāng)于200,000張高分辨率照片或500,000個(gè)文檔。要想高效且穩(wěn)定地遷移如此龐大的數(shù)據(jù)集，就必須依賴(lài)于高可靠性、高帶寬的互連技術(shù)。
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    2024/10/18
    萬(wàn)億參數(shù)模型的數(shù)據(jù)遷移挑戰(zhàn)巨大，PCIe7.0如何提升AI芯片帶寬？

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